【摘 要】
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Cache/SRAM可配置的数据存储器可根据不同应用需求动态配置为Cache、SRAM等多种访存模式,能明显提高嵌入式DSP使用的灵活性和存储效率.本文基于自主研发的一款高性能DSP
【机 构】
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国防科技大学计算机学院 长沙410073
【出 处】
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第十七届计算机工程与工艺年会暨第三届微处理器技术论坛
论文部分内容阅读
Cache/SRAM可配置的数据存储器可根据不同应用需求动态配置为Cache、SRAM等多种访存模式,能明显提高嵌入式DSP使用的灵活性和存储效率.本文基于自主研发的一款高性能DSP IP核的体系结构设计需求,设计了一种可动态配置成全Cache和L1D Cache/SRAM共享两种访存模式的标量数据存储器CSM,采用有效的多存储体高低位地址交叉组织方式,使片上存储体资源不仅在满足性能的条件下面积最小,而且在不同模式下得到充分利用；本文分别给出L1D Cache和SRAM的功能结构及配置转换逻辑.最后实验和综合结果表明,CSM的配置转换逻辑正确,主频达到1.25GHz.
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