【摘 要】
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论文主要阐述了MPEG-2解码器关键模块-运动补偿和MPEG-2解码器IO的SDRAM接口控 制电路的设计与验证.运动补偿分成三个主要模块,即控制模块,预测模块和重建模块,并与MPEG-2中
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论文主要阐述了MPEG-2解码器关键模块-运动补偿和MPEG-2解码器IO的SDRAM接口控 制电路的设计与验证.运动补偿分成三个主要模块,即控制模块,预测模块和重建模块,并与MPEG-2中的RISC CPU进行通信,使运动补偿与MPEG-2解码器的其他模块VLD和IDCT实现流水操作.预测模块根据图象类型,运动矢量等信息,对图象进行半象素内插和双向预测/双基操作.重建模块对预测结果和IDCT结果进行图象重建.文章在分析了运动补偿算法以及改进运动偿电路结构的基础上,对适合于实时处理的上述运动补偿电路进行了设计研究及验证.然后论文在分析MPEG-2解码器IO要求后,设计了MPEG-2解码器IO接口技术控制电路.最后,论文设计了测试电路,对上述电路在MPEG-2解码系统中进行了FPGA的验证.
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