【摘 要】
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该文在芯片的处理器结构上,乘法器与加法器的实现上都提出了一些新的思想与方法,并在工作站上完成了相关的设计测试与仿真工作.在乘法器的设计中,充分考虑了传统乘法器的优势
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该文在芯片的处理器结构上,乘法器与加法器的实现上都提出了一些新的思想与方法,并在工作站上完成了相关的设计测试与仿真工作.在乘法器的设计中,充分考虑了传统乘法器的优势与不足,提出了自己的分叉华莱氏树结构的乘法器模型,通过重用全加器阵列扩展了一般乘法器的功能,并做到尽量减少芯片中所占用的面积.使得处理器可以在一个乘法器单元内部同时支持32/16/8位的乘法运算.在加法器的设计中采用了控制信号切断进位链产生电路的办法,在加法器内部也可以支撑32/16/8位的运算.这样的结构使得处理器在多媒体与信号处理运算上,占有很大优势,减少了FFT、滤波等信号处理以及多媒体处理中常用算法的执行周期,提高了实际运行速度.在结构内部的设计中大量采用模块化的思想.为整个结构的底层实现打下良好的基础.
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