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设计了一种分层的二维阵列全搜索运动估计硬件电路。与传统的二维阵列全搜索运动估计电路相比，它在处理单元（PE）的并行结构设计以及存储器设计方面作出了改进，节约了硬件资源和编码时间。根据各模块的时序关系合理安排并行流水线结构，采用一列像素并行处理，实现了运动估计实时编码。
基于FPGA的全搜索运动估计硬件电路设计
【摘 要】
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设计了一种分层的二维阵列全搜索运动估计硬件电路。与传统的二维阵列全搜索运动估计电路相比，它在处理单元（PE）的并行结构设计以及存储器设计方面作出了改进，节约了硬件资源和编
【机 构】
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山东大学信息科学与工程学院
【出 处】
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电子技术应用
【发表日期】
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2014年7期
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