【摘 要】
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以实现电能采集中所需求的低功耗、小面积的乘法器为目标,设计了一种16×16位高性能阵列改进乘法器.系统采用Booth-4编码器产生部分乘积项,通过对部分积重组后并采用改进
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以实现电能采集中所需求的低功耗、小面积的乘法器为目标,设计了一种16×16位高性能阵列改进乘法器.系统采用Booth-4编码器产生部分乘积项,通过对部分积重组后并采用改进的CSA阵列完成压缩,直接得出乘法结果.这消除了传统并行乘法器的进位加法器部分,节省了大量的晶体管,从而有效降低了系统的整体功耗.设计采用0.6μm SMIC工艺布线,利用H-spice工具仿真验证,结果表明当工作在2.0V单输入电压,150MHz输入频率时,乘法器系统功耗为8.98mW,延迟为8.76ns.
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