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针对 IP核设计方法讨论了一种可动态配置编码方案的高吞吐率 RS编译码器。该编译码器采用Euclid算法实现译码 ,编译码过程采用流水线结构提高速率。整个设计使用 VHDL语言描述 ,并在 Xilinx公司的 Virtex系列上实现验证
基于FPGA自适应高速RS编译码器的IP核设计
【摘 要】
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针对 IP核设计方法讨论了一种可动态配置编码方案的高吞吐率 RS编译码器。该编译码器采用Euclid算法实现译码 ,编译码过程采用流水线结构提高速率。整个设计使用 VHDL语言描
【机 构】
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西安电子科技大学,重庆邮电学院移动通信工程研究中心
【出 处】
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重庆邮电学院学报(自然科学版)
【发表日期】
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2003年01期
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