【摘 要】
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介绍直接数字频率合成的工作原理、设计方法以及如何用FPGA来实现。为压缩ROM的容量,系统只存储0-π/2的采样值。为降低DDS相位截断误差带来的杂散,系统设置杂散抑制器。利用
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介绍直接数字频率合成的工作原理、设计方法以及如何用FPGA来实现。为压缩ROM的容量,系统只存储0-π/2的采样值。为降低DDS相位截断误差带来的杂散,系统设置杂散抑制器。利用QuaausⅡ9.0对系统进行仿真,验证设计的正确性。
Describes the working principle of direct digital frequency synthesis, design methods and how to use FPGA to achieve. To compress the ROM’s capacity, the system stores only 0-π / 2 samples. In order to reduce the spurious caused by the DDS phase truncation error, the system sets the spurious suppressor. Use Quaaus Ⅱ 9.0 to simulate the system to verify the correctness of the design.
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