高频率、低成本的SHA-256算法VLSI实现

来源 :微电子学与计算机 | 被引量 : 0次 | 上传用户：lzb0008

【摘要】

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SHA-256安全散列算法广泛应用于数据完整性校验及数字签名等领域.为满足安全SoC系统对SHA-256高工作频率和低硬件成本的设计需求,提出了一种新颖的SHA-256 VLSI实现方法,通过

【作者】

：

应建华罗柳平

【机构】

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华中科技大学电子科学与技术系

【出处】

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微电子学与计算机

【发表日期】

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2011年5期

【关键词】

：

SHA-256算法 VLSI实现关键路径面积优化 SHA-256 algorithm VLSI implementation critical path

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SHA-256安全散列算法广泛应用于数据完整性校验及数字签名等领域.为满足安全SoC系统对SHA-256高工作频率和低硬件成本的设计需求,提出了一种新颖的SHA-256 VLSI实现方法,通过分解算法实现步骤,进而缩短关键路径,节省硬件资源.采用SMIC 0.13μm CMOS工艺综合实现,结果表明其最高工作频率达334.5MHz,资源消耗减少了70%.

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