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介绍了一种二进制补码快速并行平方器的设计方法，并给出了一个6位二进制补码平方器的例子及在MAX＋PLUSⅡ10．0环境下的仿真结果。
基于FPGA的快速并行平方器
【摘 要】
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介绍了一种二进制补码快速并行平方器的设计方法，并给出了一个6位二进制补码平方器的例子及在MAX＋PLUSⅡ10．0环境下的仿真结果。
【机 构】
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西安电子科技大学
【出 处】
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电子工程师
【发表日期】
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2002年9期
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