【摘 要】
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利用Altera的QuartusII软件开发平台在FPGA上实现了I~2C总线IP核的设计。IP核满足I~2C总线的功能要求,主设备通过该IP核可以向从设备中写入或者从中读取数据,解决了I~2C总线
【机 构】
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河南科技大学电子信息工程学院,河南科技大学电子信息工程学院,河南科技大学电子信息工程学院 河南洛阳471003,河南洛阳471003,河南洛阳471003
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利用Altera的QuartusII软件开发平台在FPGA上实现了I~2C总线IP核的设计。IP核满足I~2C总线的功能要求,主设备通过该IP核可以向从设备中写入或者从中读取数据,解决了I~2C总线在SOPC中的应用问题。为了满足复用,该IP核采用Avalon总线接口,同时利用Modelsim进行了功能仿真。
Using Altera’s QuartusII software development platform in the FPGA to achieve I ~ 2C bus IP core design. IP core to meet the I ~ 2C bus function requirements, the master can write to or read from the device through the IP core data to solve the I ~ 2C bus in SOPC applications. In order to meet the multiplexing, the IP core uses the Avalon bus interface, while using Modelsim for functional simulation.
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