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期刊论文
基于FPGA的K计数环路滤波器的设计
基于FPGA的K计数环路滤波器的设计
来源 :延安大学学报(自然科学版) | 被引量 : 0次 | 上传用户:hl217348
【摘 要】
:
介绍了K计数环路滤波器的基本结构和工作原理,提出了一种基于FPGA的K计数环路滤波器的设计方法,采用Verilog硬件描述语言进行编程,Xilinx ISE软件进行综合及时序模拟。
【作 者】
:
黄保瑞
杨世平
【机 构】
:
延安大学物理与电子信息学院
【出 处】
:
延安大学学报(自然科学版)
【发表日期】
:
2014年4期
【关键词】
:
FPGA
环路滤波器
VERILOG
FPGA loop filter verilog
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介绍了K计数环路滤波器的基本结构和工作原理,提出了一种基于FPGA的K计数环路滤波器的设计方法,采用Verilog硬件描述语言进行编程,Xilinx ISE软件进行综合及时序模拟。
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