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在分析改进Booth算法双字节(16 bit)乘法器的基础上,提出一种并行的乘法器结构,并且在最后的快速进位链中运用了新的设计,提高了乘法器的速度,相对于传统的结构减少了一位全加器的数量,达到减小电路规模和芯片面积,降低乘法器功耗的目的.
双字节Booth乘法器的优化设计
【摘 要】
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在分析改进Booth算法双字节(16 bit)乘法器的基础上,提出一种并行的乘法器结构,并且在最后的快速进位链中运用了新的设计,提高了乘法器的速度,相对于传统的结构减少了一位全
【机 构】
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复旦大学
【出 处】
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复旦学报(自然科学版)
【发表日期】
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2005年1期
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