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期刊论文
基于FPGA技术全数字锁相环的设计与实现
基于FPGA技术全数字锁相环的设计与实现
来源 :电子质量 | 被引量 : 0次 | 上传用户:jay12
【摘 要】
:
锁相环器件的数字集成化,使它的应用范围日益拓宽。该文提出了基于FPGA可编程技术实现的全数字锁相环的一种设计方法。给出了实现方法和实验结果,通过仿真表明了该设计方法是成
【作 者】
:
杨辉媛
谭伟杰
满益彩
【机 构】
:
吉首大学物理科学与信息工程学院
【出 处】
:
电子质量
【发表日期】
:
2008年3期
【关键词】
:
锁相环
FPGA
VERILOG
HDL
Phase-locked loop
FPGA
Verilog HDL
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锁相环器件的数字集成化,使它的应用范围日益拓宽。该文提出了基于FPGA可编程技术实现的全数字锁相环的一种设计方法。给出了实现方法和实验结果,通过仿真表明了该设计方法是成功有效的。
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