【摘 要】
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SoC设计很大程度上依赖于IP核的可重用性.由于各IP核中时钟延时的不同,要将IP核集成到一个同步SoC中时钟分布变得很难.本文介绍了一种SoC时钟同步设计方法,这种方法将可调节
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SoC设计很大程度上依赖于IP核的可重用性.由于各IP核中时钟延时的不同,要将IP核集成到一个同步SoC中时钟分布变得很难.本文介绍了一种SoC时钟同步设计方法,这种方法将可调节延时的时钟电路插入在时钟分布网络中,以取得时钟边沿的匹配和同步.使用可调节电路进行时序调整,减少了设计迭代时间,节约了设计成本.
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