【摘 要】
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Power dissipation has become one of the key optimization conditions in logic design on field programmable gate arrays (FPGAs), thus the power estimation is nece
【机 构】
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SchoolofCommunicationandInformationEngineering,DepartmentofComputerScienceandEngineering,GuangzhouIn
【基金项目】
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This work was supported by the National Natural Science Foundation of China under Grant No. 61176025 and No. 61006027, the Fundamental Research Funds for the Central Universities under Grant No. ZYGX2
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Power dissipation has become one of the key optimization conditions in logic design on field programmable gate arrays (FPGAs), thus the power estimation is necessary for logic design optimization. Nowadays, signal activity data created by logic simulation
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