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该设计为了实现低功耗异步FIFO存储器设计,采用格雷码指针解决设计中的亚稳态问题,并采用门控时钟技术降低功耗,利用VerilogHDL硬件描述语言,在ModelSimSE6.5a中进行功能仿真,Synopsys DC综合结果显示降低功耗20.7%。
基于格雷码的异步FIFO存储器的设计
【摘 要】
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该设计为了实现低功耗异步FIFO存储器设计,采用格雷码指针解决设计中的亚稳态问题,并采用门控时钟技术降低功耗,利用VerilogHDL硬件描述语言,在ModelSimSE6.5a中进行功能仿真
【机 构】
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贵州大学理学院电子科学系
【出 处】
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电脑知识与技术
【发表日期】
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2010年9X期
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