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介绍了一种Turbo译码交织器的现场可编程门阵列（Field Programmable Gate Array，FPGA）硬件实现方案，将交织算法的软件编程和FPGA内部的硬件存储块相结合，有效地降低了译码器的硬件实现复杂度，减小了译码延时，并且给出了具体的译码器内交织器FPGA实现原理框图。
基于FPGA的Turbo译码交织器设计
【摘 要】
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介绍了一种Turbo译码交织器的现场可编程门阵列（Field Programmable Gate Array，FPGA）硬件实现方案，将交织算法的软件编程和FPGA内部的硬件存储块相结合，有效地降低了译码器的硬件
【机 构】
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哈尔滨工程大学信息与通信工程学院
【出 处】
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信息与电子工程
【发表日期】
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2007年3期
【基金项目】
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黑龙江省自然科学基金资助项目（F200503）
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