A simulation of hardware logic scheduling core

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RTOS(Real-time operating system)in the embedded systems become increasingly wide-spread.The introduction of the RTOS makes the development of applications easier and improves the reliability of the system.However,The CPU overheads imposed by the RTOS reduce the time available for processing user tasks.In order to makes the effective CPU time occupied minimization.this article designed a hardware logic scheduling core of RTOS.Mainly related to the preparation of VHDL source code.ills well as simulation with modelsim to achieve its basic scheduling functions.simulation results show the correctness of the design.
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