基于CPLD的WatchDog电路设计

来源 :数字技术与应用 | 被引量 : 0次 | 上传用户：sddcx

【摘要】

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论述了基于CPLD的WatchDog设计,该设计实现对主机CPU运行状态的监控,若看门狗电路在规定时间内未收到主机CPU的＂喂狗＂信号,则输出复位信号复位主机CPU,主机可通过配置专用寄存

【作者】

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金华于瑞华

【机构】

：

中国人民公安大学安全防范系

【出处】

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数字技术与应用

【发表日期】

：

2010年2期

【关键词】

：

CPLD VHDL 看门狗 CPLD VHDL WatchDog

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论述了基于CPLD的WatchDog设计,该设计实现对主机CPU运行状态的监控,若看门狗电路在规定时间内未收到主机CPU的＂喂狗＂信号,则输出复位信号复位主机CPU,主机可通过配置专用寄存器设置看门狗＂喂狗＂时间.由于采用VHDL硬件描述语言,容易使设计与其它逻辑设计集成在一起,达到模块化和可重用的效果.

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