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采用2位分组进行并行分工计数,使用二叉树的电路结构进行108位前导0计数器电路设计.采用2位分组的108位前导0计数器电路进行PT分析的时序为0.17,而采用8位分组的RTL级代码进行DC综合的时序为0.21,通过比较发现设计电路在速度上比RTL级代码快了19%.
108位前导0计数器的电路设计与优化
【摘 要】
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采用2位分组进行并行分工计数,使用二叉树的电路结构进行108位前导0计数器电路设计.采用2位分组的108位前导0计数器电路进行PT分析的时序为0.17,而采用8位分组的RTL级代码进
【机 构】
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国防科学技术大学计算机学院
【出 处】
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微电子学与计算机
【发表日期】
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2015年4期
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