JPEG 2000自适应算术编码器FPGA设计

来源 :北京理工大学学报 | 被引量 : 0次 | 上传用户：ran871229

【摘要】

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研究JPEG 2000标准中自适应算术编码器的硬件实现问题, 提出一种适合ASIC实现的并行结构, 并在FPGA上对其进行了仿真验证.该设计使用VHDL语言在RTL级描述; 并以XILINX XC2V80

【作者】

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杨珂刘明业

【机构】

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北京理工大学信息科学技术学院计算机科学工程系

【出处】

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北京理工大学学报

【发表日期】

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2005年3期

【关键词】

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JPEG 2000 嵌入式块编码算术编码器 FPGA 图像压缩硬件描述语言 JPEG 2000 EBCOT arithmetic encoder FPGA

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研究JPEG 2000标准中自适应算术编码器的硬件实现问题, 提出一种适合ASIC实现的并行结构, 并在FPGA上对其进行了仿真验证.该设计使用VHDL语言在RTL级描述; 并以XILINX XC2V8000-5FF1152为基础, 在ISE 5.2下完成综合及后仿真.在整个JPEG 2000设计中, 最高工作时钟66 MHz, 自适应算术编码器处理速度可达到0.25 bit/cycle.

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