基于FPGA的ISO/IEC 18000-6C RFID读写器设计

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“物联网”,被誉为全球经济复苏的动力和第三次信息技术革命,对国家甚至世界经济和科技发展都有着重要作用。如今,物联网的发展已成为各国高科技技术和信息技术产业化的竞争热点,美国将物联网技术的发展提升到国家级信息化技术发展的高度,我国将其列入国家重点发展的信息科技新兴产业行列。作为物联网关键技术之一的RFID技术,近几年也受到了各国政府及IT研发人员的青睐。我国RFID产业起步晚,相对落后,特别是UHF频段。所以研究一款具有自主知识产权、性能优秀的UHF频段读写器对发展中国RFID技术、推动物联网产业发展和满足市场需求都是非常重要的。正是出于以上原因,本论文研究并设计实现了一款中心频率为915MHz基于FPGA的ISO/IEC 18000-6C协议的RFID读写器,论文主要工作包括:首先,简介现存的超高频协议,详细阐述ISO/IEC 18000-6C主要内容。其次,提出读写器的整体设计框架。针对射频收发机设计,研究各部分功能及设计技巧。发射通路采用数字频率合成芯片Si4133产生载波,通过HMC284调制,然后经过SPA2118进行功率放大,最后经天线发送。考虑接收机由于收发采用一路天线而具有较大干扰和ASK调制特点,使用I、Q两路二极管检波电路,检波信号经过放大,最后通过比较器得出解调信号。射频收发机采用分离元件搭建,设计简单、易于测试、成本较低。再次,研究、仿真并实现基于FPGA的数字基带处理部分。此部分全部采用FPGA内部逻辑资源实现,分模块设计,包括编解码模块、防碰撞模块、校验模块、协议栈模块和接口模块等。FM0解码时,考虑接收到的标签FM0编码数据可能因为环境噪音或者解调电路不完善影响解调信号完整性,编码数据存在脉冲宽度不规则,所以设计采用脉冲宽度解码而非采样解码法。防碰撞部分,是所有读写器设计的技术瓶颈,论文在研究防碰撞算法原理和防碰撞流程之后,提出一种简单的Q值选择算法,并将其应用。最后,通过系统测试平台对开发的读写器进行系统测试和数据提取。通过分析图片和数据,得出读写器达到预期功能的结论。
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