【摘 要】
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为提高锁相环（phase-locked loop,PLL）的动态性能和锁相精确度,提出一种基于dq变换的改进锁相环,其通过平均值环节而不是延时信号消除（delayed signal cancellation,DSC）或低通滤
【机 构】
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哈尔滨工业大学电气工程及自动化学院
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为提高锁相环（phase-locked loop,PLL）的动态性能和锁相精确度,提出一种基于dq变换的改进锁相环,其通过平均值环节而不是延时信号消除（delayed signal cancellation,DSC）或低通滤波器（low pass filter,LPF）预先将负序与谐波分离出去,大幅缩短了暂态响应时间,同时亦消除了系统电压不平衡或畸变对锁相精确度的影响.详述了该PLL的工作原理;给出了关于负序与谐波分离方法的讨论;推导了控制环的线性化模型及其PI参数的整定方法.仿真与实验结果表明,由于采用
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