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设计了一个用于10 Mb/s和100 Mb/s 以太网的时钟数据恢复电路,采用双环路结构,增加了系统的稳定性.电路各组成部分的设计进一步增强了锁相环工作的稳定性.电路行为级仿真采用Mentor的ADMS,电路级设计采用Chartered 0.25 μm CMOS工艺.
用于10Mb／s和100Mb／s以太网的时钟数据恢复电路
【摘 要】
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设计了一个用于10 Mb/s和100 Mb/s 以太网的时钟数据恢复电路,采用双环路结构,增加了系统的稳定性.电路各组成部分的设计进一步增强了锁相环工作的稳定性.电路行为级仿真采用
【机 构】
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复旦大学
【出 处】
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微电子学
【发表日期】
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2002年4期
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