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本文利用Verilog硬件描述语言设计了一个寄存器堆,并对其进行了仿真测试。该寄存器堆包含32个32位的寄存器,具有2个读端口和1个写端口,仿真结果表明该寄存器堆的功能是正确的。
寄存器堆设计方法研究
【摘 要】
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本文利用Verilog硬件描述语言设计了一个寄存器堆,并对其进行了仿真测试。该寄存器堆包含32个32位的寄存器,具有2个读端口和1个写端口,仿真结果表明该寄存器堆的功能是正确的
【机 构】
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青岛科技大学信息科学技术学院
【出 处】
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科技信息
【发表日期】
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2010年33期
【基金项目】
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青岛市科技计划项目《可移动高性能电脑加密机的研究与设计》提供支持
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